状态机常用状态编码有（）。

EDA缩写的含义为（）

填空题EDA缩写的含义为（）

有限状态机分为（）和Mealy两种类型。

填空题有限状态机分为（）和Mealy两种类型。

试使用 Verilog HDL 设计一个 10 进制计数器，规定模块定义为 modulecount10(out...

问答题

试使用 Verilog HDL 设计一个 10 进制计数器，规定模块定义为 modulecount10(out,clr,clk),其中 clk 为时钟输入，clr 为同步清零输入，低电平有效，out 为计数器输出。
（1） 写出 10 进制计数器 Verilog HDL 设计程序并注释；
（2） 写出 10 进制计数器 Verilog HDL 测试文件并注释；