单项选择题
FPGA实现DDS架构的设计如图所示，包括分频器、地址发生器及波形存储器，分频系数divider[15..0]、步长freq[1..0]，改变哪个参数可以改变输出信号的频率？（）
A.freq[1..0]
B.clk
C.divider[15..0]
D.rst
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单项选择题
FPGA实现DDS架构的设计如图所示，包括分频器、地址发生器及波形存储器，分频系数divider[15..0]、步长freq[1..0]，改变哪个参数可以改变输出信号的频率？（）
A.freq[1..0]
B.clk
C.divider[15..0]
D.rst
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