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全部科目 > 大学试题 > 工学 > 动力与电气工程 > 现场可编程逻辑门阵列(FPGA)

填空题

HDL综合器就是逻辑综合的过程,把可综合的VHDL/Verilog HDL转化成硬件电路时,包含了三个过程,分别是()、()、()。

【参考答案】

转化;优化;映射

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