欢迎来到牛牛题库网 牛牛题库官网
logo
全部科目 > 大学试题 > 计算机科学 > verilog

问答题

简答题

设计一个带复位端且对输入时钟clk进行二分频模块,设计要求:复位信号为同步、高电平有效,时钟的下降沿触发。

【参考答案】

点击查看答案
微信小程序免费搜题
微信扫一扫,加关注免费搜题

微信扫一扫,加关注免费搜题