单项选择题
A.2’d66B.8’b0110_0110C.8’d42D.7’h42
VerilogHDL语言中,不属于并行语句的是()A.caseB.alwaysC.assignD.元件例化
单项选择题VerilogHDL语言中,不属于并行语句的是()
A.caseB.alwaysC.assignD.元件例化
一个module中,包含了多条连续的assign语句,它们执行时,是()执行的。A.至上而下B.同时并行C.仅...
单项选择题一个module中,包含了多条连续的assign语句,它们执行时,是()执行的。
A.至上而下B.同时并行C.仅最后一条有效D.看情况,不好说
定义一个256字节的存储器,位宽为8,应表示为()A.reg [8:0]Storage[256:0];B.re...
单项选择题定义一个256字节的存储器,位宽为8,应表示为()
A.reg [8:0]Storage[256:0];B.reg [7:0]Storage[255:0];C.reg [255:0]Storage[7:0];D.reg [256:0]Storage[8:0];